Verical CPLD: dispositivos lógicos de programación complejos

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CPLD ispGDS Family 22 Macro Cells EECMOS Technology 5V 28-Pin PLCC
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SPLD GAL Family 8 Macro Cells 80MHz EECMOS Technology 5V 24-Pin PDIP
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CPLD, ispGDS Family, EECMOS Process, 14 Macro Cells, 14 User I/Os, 5V Supply, 7 Speed Grade, 20DIP
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CPLD MACH 1 Family 2.5K Gates 64 Macro Cells 100MHz EECMOS Technology 5V 100-Pin TQFP
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CPLD ispMACH® 4000V Family 256 Macro Cells 227MHz 3.3V 256-Pin FTBGA Tray
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Modelos CAD
SPLD PAL® Family 200 Gates 8 Macro Cells 62.5MHz EECMOS Technology 5V 20-Pin PLCC
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CPLD ispLSI® 2000A Family 2K Gates 64 Macro Cells 81MHz 0.35um Technology 5V 100-Pin TQFP
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Modelos CAD
CPLD ispLSI® 2000 Family 1K Gates 32 Macro Cells 154MHz 0.35um Technology 5V 48-Pin TQFP
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SPLD PAL® Family 10 Macro Cells 62.5MHz EECMOS Technology 5V 28-Pin PLCC
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CPLD ispMACH 4A Family 1.25K Gates 32 Macro Cells 83.3MHz/118MHz 3.3V 44-Pin PLCC Tube
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