Verical CPLD: dispositivos lógicos de programación complejos

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CPLD MAX 7000 Family 1.25K Gates 64 Macro Cells 166.7MHz CMOS Technology 5V 84-Pin PLCC
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SPLD GAL Family 8 Macro Cells 166MHz EECMOS Technology 3.3V 20-Pin PLCC
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CPLD MAX® 7000A Family 600 Gates 32 Macro Cells 103.1MHz 3.3V 44-Pin PLCC
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Modelos CAD
CPLD MAX 7000S Family 1.25K Gates 64 Macro Cells 166.7MHz CMOS Technology 5 Volt 84-Pin PLCC
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Simple Programmable Logic Devices - SPLDs 16 Input, 8 Output 5V, Low Power, 15ns
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Modelos CAD
CPLD MAX® 7000A Family 10K Gates 512 MacroCells 116.3MHz 3.3V 256-Pin BGA Tray
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CPLD MAX® 7000BFamily 10KGates 512Macro Cells 119MHz 2.5V 256-Pin FBGA Tray
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CPLD MAX 7000A Family 1.25K Gates 64 Macro Cells 100MHz CMOS Technology 3.3V 44-Pin TQFP
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CPLD MAX® 7000S Family 3.2K Gates 160 Macro Cells 100MHz 5V 100-Pin TQFP Tray
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CPLD MAX® 7000 Family 2.5K Gates 128 MacroCells 100MHz 5V 160-Pin PQFP Tray
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